苏州招聘

岗位职责：
大规模集成电路的RTL编码规则检查，参与编写时序约束，进行模块及芯片级综合，功耗分析及静态时域分析；

岗位要求：
1.掌握一定的Verilog和RTL编程能力，善于根据设计规格编写时序约束；
2.精通Synopsys DC Compiler和多电源域设计流程；
3.善于利用Synopsys时域分析工具分析时序问题；
4.了解后端APR流程，善于协助后端工程师解决功耗和时序问题；
5.工作细致认真，善于交流，有团队合作精神；
6.硕士或者学士并具有3年及以上的IC设计相关经验。

Email：candyhu.vision@gmail.com

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