北京招聘

职位描述：
SOC Verification@上海闵行区 简历发 hr@hi-talent.com
（提供员工宿舍+人才引进落户）我相信这是趋势很给力！
Responsibilities:
1. Understanding the expected functionality of designs;
2. Developing testing and regression plans;
3. Designing and developing verification environment;
4. Running RTL and gate-level simulations/regression;
5. Code/functional coverage development, analysis and closure.
Requirements:
1. Minimum of 3 years designerification experience (test plan, test bench, assertions, debugging designs, code coverage etc.);
2. Knowledge in ASIC/FPGA design process and verification tools/env ( UVM/OVM…);
3. Familiar with design and verification languages (Verilog, System Verilog, SVA etc.);
4. Scripting and automation skills (tcl, perl, makefile etc) a plus;
5. Familiar with C/C++;
6. Knowledge of DDR/Video/ARM/USB/PCIE , Low Power Verification with UPF and design experience is a plus;
7. Experience in CPU/DSP verification, including test plan and test bench development, test case development and test coverage assessment. and Knowledge of computer architecture and micro-architecture (pipeline, out-of-order, cache) is a plus
8. Additional qualifications include: Good IC verification skills and basic knowledge of logic or circuit design, good communication and problem solving skills;
9. Independent and self-managing.

SOC验证工程师/经理@上海闵行 简历发 hr@hi-talent.com
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工作职责：
1、根据 Design SPEC 制定验证计划；
2、搭建模块及系统级验证平台；
3、开发设计验证模型 （BFM，TLM等）；
4、产生测试向量，跟踪测试需求；
5、根据验证计划，按时完成验证任务。
任职要求：
1、电子或计算机硕士及以上学历；
2、2年以上相关工作经验，至少一次成功流片经验；
3、深入理解 ASIC 设计流程，对 VMM/OVM/UVM 等验证方法学有较深的理解；
4、熟悉 ARM/DSP core 和 AMBA AHB/AXI 总线协议，各种标准外设（I2C，UART，USB等）接口协议；
5、熟练使用 verilog / system verilog 和脚本语言（Python，Perl，Shell，TCL 等），独立搭建模块及系统级验证平台；
6、较强的英文读写能力及团队协作精神。

备注：
浦西闵行区某半导体公司，至少3个新员工起，公司提供租房，先到先得，有模拟和IC设计和验证 简历发 hr@hi-talent.com 公司给员工工程师或高管提供租房 史上绝无仅有的提供公司公寓的好offer 补充一句可以人才引进落户

Principal Consultant & General Manager @ Hi-Talent Consulting Co.,Ltd.
上海芯得企业管理咨询有限公司
上海芯相会企业管理咨询有限公司
上海戴引企业管理咨询有限公司
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